Chipimplementation einer zweidimensionalen Fouriertransformation für dieAuswertung eines Sensor-Arrays

Abstract

In der Bachelorarbeit wird eine 8x8 zweidimensionale Fourier Transformation in VHDL für den Einsatz als Teilmodul auf einem ASIC entwickelt. Dabei wird das Chipdesign-Tool Cadence verwendet. Die Transformation wird durch eine Matrixmultiplikation realisiert und hinsichtlich Taktzyklen und Flächenbedarf optimiert, sodass ein minimaler Aufwand erforderlich ist. Ferner werden Tests zur Funktionalität durchgeführt und der Floorplan erstellt.

In this bachelor thesis a 8x8 twodimensional Fourier transform is developed in VHDL as a partial modul for the usage on an ASIC. For the implementation the chipdesign tool Cadence is used. The transform is realized as a matrix multiplication and optimized in terms of clock cycles and required area. Functionality test are executed and the floorplan is created.